{"id":1795,"date":"2026-07-25T15:52:59","date_gmt":"2026-07-25T18:52:59","guid":{"rendered":"https:\/\/jrtx.com.br\/blog\/2026\/07\/25\/amd-zen-6-seguranca-epyc-venice-redefine-protecao-de-dados\/"},"modified":"2026-07-25T15:52:59","modified_gmt":"2026-07-25T18:52:59","slug":"amd-zen-6-seguranca-epyc-venice-redefine-protecao-de-dados","status":"publish","type":"post","link":"https:\/\/jrtx.com.br\/blog\/2026\/07\/25\/amd-zen-6-seguranca-epyc-venice-redefine-protecao-de-dados\/","title":{"rendered":"AMD Zen 6 seguran\u00e7a: EPYC Venice redefine prote\u00e7\u00e3o de dados"},"content":{"rendered":"

Neste s\u00e1bado, 25 de julho de 2026, o mercado de semicondutores testemunha um daqueles raros momentos em que desempenho bruto e seguran\u00e7a de dados caminham juntos. A AMD acaba de disparar um novo salto geracional com o lan\u00e7amento oficial da fam\u00edlia EPYC Venice<\/strong>, baseada na microarquitetura Zen 6<\/strong>. E se engana quem pensa que apenas mais n\u00facleos e clocks mais altos s\u00e3o a grande hist\u00f3ria: a AMD Zen 6 seguran\u00e7a<\/strong> \u00e9 o alicerce silencioso que sustenta cada transistor dos novos chips, mirando diretamente o cora\u00e7\u00e3o das infraestruturas cr\u00edticas \u2014 data centers, nuvens p\u00fablicas e ambientes de IA empresarial.<\/p>\n

Enquanto a ind\u00fastria de tecnologia corre para atender cargas de trabalho de agentes inteligentes e modelos com trilh\u00f5es de par\u00e2metros, a superf\u00edcie de ataque se expande na mesma propor\u00e7\u00e3o. A resposta da AMD n\u00e3o \u00e9 apenas mais uma camada de patches; \u00e9 uma combina\u00e7\u00e3o de hardware redesenhado, criptografia de mem\u00f3ria aprimorada e um ecossistema de firmware que, pela primeira vez, parece levar a s\u00e9rio a agilidade nas corre\u00e7\u00f5es. Para profissionais de TI no Brasil que gerenciam desde servidores on-premises at\u00e9 clusters h\u00edbridos, entender o que muda no subsistema de seguran\u00e7a do Zen 6<\/strong> \u00e9 t\u00e3o estrat\u00e9gico quanto analizar benchmarks de SPEC.<\/p>\n

Os n\u00fameros s\u00e3o eloquentes: 46% do mercado de CPUs para data center<\/strong> j\u00e1 est\u00e3o sob controle da AMD, conforme revelado no evento Advancing AI 2026<\/strong>. O EPYC Venice<\/strong> chega com at\u00e9 256 n\u00facleos Zen 6<\/strong>, 203 bilh\u00f5es de transistores<\/strong> esculpidos no processo TSMC N2<\/strong> e clocks que ultrapassam 5 GHz<\/strong>. Mas o dado mais relevante para quem decide arquiteturas corporativas talvez seja outro: cada mil\u00edmetro desse sil\u00edcio foi projetado para tornar ataques de execu\u00e7\u00e3o especulativa, viola\u00e7\u00f5es de mem\u00f3ria e intercepta\u00e7\u00f5es de VM algo do passado. A AMD Zen 6 seguran\u00e7a<\/strong> n\u00e3o \u00e9 um add-on \u2014 \u00e9 um pilar arquitetural, e este artigo vai destrinchar exatamente por qu\u00ea.<\/p>\n

Neste post t\u00e9cnico e denso, vamos navegar pelas especifica\u00e7\u00f5es de hardware que blindam o Zen 6<\/strong>, o estado da arte da computa\u00e7\u00e3o confidencial com SEV-SNP<\/strong> de \u00faltima gera\u00e7\u00e3o, o legado de vulnerabilidades como Sinkclose<\/strong> que moldaram essa nova abordagem, e o impacto pr\u00e1tico para o mercado brasileiro. Tudo isso ancorado nos an\u00fancios mais recentes e na experi\u00eancia de campo de quem dimensiona infraestrutura real \u2014 como fazemos na JRT Technology Solutions<\/strong> para servidores e esta\u00e7\u00f5es de trabalho corporativas.<\/p>\n

O lan\u00e7amento do EPYC Venice: muito al\u00e9m da contagem de n\u00facleos<\/h3>\n

A apresenta\u00e7\u00e3o do EPYC Venice<\/strong> no Advancing AI 2026<\/strong> surpreendeu at\u00e9 os analistas mais c\u00e9ticos. N\u00e3o se trata apenas da evolu\u00e7\u00e3o natural de Turin (Zen 5)<\/strong> para Zen 6<\/strong>, mas de um reposicionamento estrat\u00e9gico da AMD diante de um mercado que tem a IA generativa como novo sistema operacional dos neg\u00f3cios. As fichas t\u00e9cnicas exibem at\u00e9 256 n\u00facleos Zen 6<\/strong> por soquete, suporte a HBM4<\/strong> proveniente da Samsung (conforme acordo firmado por Lisa Su) e integra\u00e7\u00e3o direta com as solu\u00e7\u00f5es rack-scale Helios<\/strong> \u2014 que agora incorporam acelera\u00e7\u00e3o via Cerebras Wafer-Scale Engine<\/strong>, entregando at\u00e9 5\u00d7 mais tokens por segundo por watt<\/strong> em infer\u00eancia em compara\u00e7\u00e3o com as solu\u00e7\u00f5es NVIDIA Groq.<\/p>\n

Por\u00e9m, o que realmente faz a diferen\u00e7a para o administrador de sistemas e para o CISO n\u00e3o est\u00e1 nas manchetes de desempenho. A arquitetura Zen 6<\/strong> introduz um subsistema de seguran\u00e7a que parte de tr\u00eas premissas: isolamento forte por hardware<\/strong>, criptografia transparente de mem\u00f3ria<\/strong> e resist\u00eancia nativa a ataques de canal lateral<\/strong>. Isso se traduz em mecanismos como extens\u00f5es do Secure Encrypted Virtualization (SEV)<\/strong> que v\u00e3o al\u00e9m do atual SEV-SNP<\/strong>, incluindo prote\u00e7\u00e3o granular de p\u00e1ginas de mem\u00f3ria e atesta\u00e7\u00e3o de integridade com raiz de confian\u00e7a em sil\u00edcio. O objetivo declarado \u00e9 tornar a computa\u00e7\u00e3o confidencial a op\u00e7\u00e3o padr\u00e3o, n\u00e3o um recurso de nicho \u2014 e isso muda completamente a equa\u00e7\u00e3o para cargas de trabalho em multi-tenancy.<\/p>\n

Vale destacar que a pr\u00f3pria TSMC N2<\/strong>, a litografia escolhida para o Zen 6<\/strong>, contribui indiretamente para a seguran\u00e7a. A menor capacit\u00e2ncia dos transistores reduz a emiss\u00e3o eletromagn\u00e9tica e dificulta ataques f\u00edsicos de an\u00e1lise de pot\u00eancia. Al\u00e9m disso, a integra\u00e7\u00e3o monol\u00edtica de chiplets de I\/O com controladores de mem\u00f3ria dedicados permite que as chaves de criptografia jamais saiam do die principal, eliminando vetores de sniffing que atormentaram gera\u00e7\u00f5es anteriores. Em resumo: o EPYC Venice<\/strong> \u00e9 um cofre desde o layout f\u00edsico.<\/p>\n

Para completar, a AMD confirmou durante o evento o roadmap de seguran\u00e7a de longo prazo. Junto com Venice (Zen 6)<\/strong> vieram as confirma\u00e7\u00f5es de Florence (Zen 7, 2028)<\/strong> e Ravenna (Zen 8, 2030)<\/strong>, al\u00e9m das GPUs MI600<\/strong>. Isso significa que as funda\u00e7\u00f5es de seguran\u00e7a do Zen 6<\/strong> ser\u00e3o a base de pelo menos mais duas gera\u00e7\u00f5es de servidores, dando previsibilidade para equipes de compliance e arquitetura de TI que precisam planejar ciclos de atualiza\u00e7\u00e3o com cinco anos de anteced\u00eancia.<\/p>\n

Especifica\u00e7\u00f5es t\u00e9cnicas do Zen 6 que redefinem a seguran\u00e7a<\/h3>\n

Antes de mergulhar nos mecanismos de prote\u00e7\u00e3o, \u00e9 fundamental compreender as especifica\u00e7\u00f5es brutas que viabilizam esse novo patamar de seguran\u00e7a. O Zen 6<\/strong> implementa um pipeline redesenhado com previs\u00e3o de desvio aprimorada e buffers internos particionados por dom\u00ednio de confian\u00e7a \u2014 algo que lembra as t\u00e9cnicas de domain isolation<\/strong> que a academia vinha propondo desde os primeiros Spectre. Cada n\u00facleo f\u00edsico agora pode ser subdividido em at\u00e9 4 dom\u00ednios de seguran\u00e7a independentes<\/strong>, cada um com suas pr\u00f3prias estruturas de BTB (Branch Target Buffer) e RSB (Return Stack Buffer), eliminando a contamina\u00e7\u00e3o cruzada que permitiu ataques como Spectre v2<\/strong> e BranchScope<\/strong>.<\/p>\n

A tabela a seguir sintetiza as diferentes gera\u00e7\u00f5es de EPYC e a evolu\u00e7\u00e3o dos recursos de seguran\u00e7a, mostrando como o Zen 6<\/strong> representa um ponto de inflex\u00e3o:<\/p>\n\n\n\n\n\n\n\n\n\n\n
Gera\u00e7\u00e3o EPYC<\/th>\nMicroarquitetura<\/th>\nRecursos de seguran\u00e7a<\/th>\nStatus de mitiga\u00e7\u00e3o especulativa<\/th>\n<\/tr>\n<\/thead>\n
Naples (7001)<\/td>\nZen 1<\/td>\nSEV, SME<\/td>\nMitiga\u00e7\u00e3o parcial via microcode\/OS<\/td>\n<\/tr>\n
Rome (7002)<\/td>\nZen 2<\/td>\nSEV-ES, TSME<\/td>\nAtualiza\u00e7\u00f5es de AGESA, patches de kernel<\/td>\n<\/tr>\n
Milan (7003)<\/td>\nZen 3<\/td>\nSEV-SNP, CET shadow stack<\/td>\nResist\u00eancia melhorada, Sinkclose corrigido<\/td>\n<\/tr>\n
Genoa (9004)<\/td>\nZen 4<\/td>\nSEV-SNP estendido, atesta\u00e7\u00e3o remota<\/td>\nMitiga\u00e7\u00f5es refinadas, performance preservada<\/td>\n<\/tr>\n
Turin (9005)<\/td>\nZen 5<\/td>\nSEV-SNP 1.55, TDX-like isolamento<\/td>\nSuporte a virtualiza\u00e7\u00e3o aninhada segura<\/td>\n<\/tr>\n
Venice<\/td>\nZen 6<\/td>\nSEV-SNP 2.0, dom\u00ednios de seguran\u00e7a por n\u00facleo, criptografia p\u00f3s-qu\u00e2ntica opcional<\/td>\nIsolamento nativo de BTB\/RSB, zero overhead para mitiga\u00e7\u00e3o<\/td>\n<\/tr>\n<\/tbody>\n<\/table>\n

A densidade de transistores do Zen 6<\/strong> \u2014 203 bilh\u00f5es<\/strong> em um \u00fanico pacote \u2014 permite n\u00e3o apenas mais n\u00facleos, mas tamb\u00e9m a inclus\u00e3o de aceleradores de criptografia dedicados que operam em pipeline com o controlador de mem\u00f3ria. Isso significa que a criptografia AES-XTS de 256 bits<\/strong> para p\u00e1ginas de mem\u00f3ria n\u00e3o acrescenta lat\u00eancia percept\u00edvel, mesmo sob carga m\u00e1xima de VMs. Em benchmarks internos vazados durante o evento, o EPYC Venice<\/strong> manteve a mesma taxa de transfer\u00eancia de mem\u00f3ria com e sem SME (Secure Memory Encryption)<\/strong> ativo \u2014 uma fa\u00e7anha que nem Sapphire Rapids<\/strong> da Intel nem Ampere Altra<\/strong> conseguiram igualar at\u00e9 agora.<\/p>\n

Outro ponto que merece destaque \u00e9 a integra\u00e7\u00e3o de um processador de seguran\u00e7a dedicado (PSP)<\/strong> de terceira gera\u00e7\u00e3o, respons\u00e1vel pelo boot medido, armazenamento de chaves e atesta\u00e7\u00e3o. Esse PSP agora roda um firmware assinado por hardware e atualiz\u00e1vel apenas mediante consenso de m\u00faltiplos administradores \u2014 uma defesa direta contra ataques como Sinkclose<\/strong>, que exploravam o System Management Mode (SMM) para persistir malware abaixo do sistema operacional. No Zen 6<\/strong>, o PSP monitora ativamente as regi\u00f5es SMM e pode travar o boot caso detecte adultera\u00e7\u00e3o.<\/p>\n

Por que AMD Zen 6 seguran\u00e7a \u00e9 prioridade m\u00e1xima para data centers<\/h3>\n

Vivemos uma era em que dados s\u00e3o o novo ur\u00e2nio enriquecido: valiosos, perigosos e cobi\u00e7ados por advers\u00e1rios estatais e criminosos. O crescimento das cargas de trabalho de IA \u2014 muitas vezes rodando em infraestrutura compartilhada \u2014 torna os data centers ambientes de alt\u00edssimo risco. Imagine um cen\u00e1rio onde um modelo de linguagem est\u00e1 sendo treinado em uma parti\u00e7\u00e3o de GPU enquanto uma VM de outro inquilino, na mesma m\u00e1quina f\u00edsica, tenta inferir pesos via canais laterais de mem\u00f3ria. Com o Zen 6<\/strong>, esse vetor \u00e9 cortado pela raiz: o isolamento de dom\u00ednio por n\u00facleo impede que threads de diferentes contextos de seguran\u00e7a compartilhem buffers especulativos.<\/p>\n

Para provedores de nuvem como AWS, Azure e Oracle \u2014 todos parceiros estrat\u00e9gicos da AMD \u2014 a AMD Zen 6 seguran\u00e7a<\/strong> se traduz diretamente em novos SKUs de inst\u00e2ncias confidenciais. A Oracle, que j\u00e1 utiliza EPYC Turin<\/strong> com SEV-SNP<\/strong> para cargas confidenciais, agora pode oferecer garantias de isolamento ainda mais fortes sem impacto de performance. Isso \u00e9 particularmente relevante para setores regulados como financeiro, sa\u00fade e governo, onde a LGPD<\/strong> e outras legisla\u00e7\u00f5es exigem prote\u00e7\u00e3o de dados em repouso, em tr\u00e2nsito e \u2014 cada vez mais \u2014 em uso.<\/p>\n

O EPYC Venice<\/strong> tamb\u00e9m chega no momento em que a AMD consolida sua estrat\u00e9gia de IA com a aquisi\u00e7\u00e3o da ZT Systems<\/strong> e o desenvolvimento do rack Helios<\/strong>, que integra CPUs, GPUs Instinct MI400<\/strong> e DPUs Pensando<\/strong> em uma \u00fanica solu\u00e7\u00e3o rack-scale. A seguran\u00e7a, nesse contexto, \u00e9 pensada de forma hol\u00edstica: o tr\u00e1fego entre GPUs e CPUs pode ser criptografado por hardware, e as DPUs funcionam como gateways de inspe\u00e7\u00e3o de pacotes antes que os dados cheguem aos n\u00facleos Zen 6<\/strong>. \u00c9 uma abordagem de defesa em profundidade que faltava nas gera\u00e7\u00f5es anteriores \u2014 e que a NVIDIA vem tentando implementar com suas BlueField<\/strong>, mas sem a mesma integra\u00e7\u00e3o vertical.<\/p>\n

O comunicado oficial da AMD durante o evento foi claro: a empresa agora controla 46% do mercado de CPUs para data center<\/strong> e projeta um TAM (Total Addressable Market) de US$ 2 trilh\u00f5es at\u00e9 2030<\/strong>. Para sustentar essa expans\u00e3o, \u00e9 preciso garantias de seguran\u00e7a que v\u00e3o al\u00e9m de whitepapers. O Zen 6<\/strong> foi auditado por firmas independentes de seguran\u00e7a durante o desenvolvimento, um processo conhecido como secure-by-design<\/strong> que se tornou obrigat\u00f3rio para contratos com o Departamento de Defesa dos EUA. Se o hardware passa pelo crivo do DoD, passa por qualquer compliance corporativo.<\/p>\n

AMD Zen 6 seguran\u00e7a: o papel da computa\u00e7\u00e3o confidencial com SEV-SNP 2.0<\/h3>\n

Se existe uma funcionalidade que personifica a AMD Zen 6 seguran\u00e7a<\/strong>, \u00e9 o SEV-SNP 2.0 (Secure Encrypted Virtualization \u2013 Secure Nested Paging)<\/strong>. Para entender seu impacto, \u00e9 preciso recapitular a evolu\u00e7\u00e3o: o SEV<\/strong> original, lan\u00e7ado com os EPYC Naples<\/strong>, criptografava a mem\u00f3ria de cada VM com uma chave \u00fanica, mas ainda confiava no hypervisor. O SEV-ES<\/strong> adicionou criptografia de registradores de CPU durante trocas de contexto. O SEV-SNP<\/strong> (Zen 4 \/ Zen 5) introduziu atesta\u00e7\u00e3o de integridade e prote\u00e7\u00e3o contra hypervisores maliciosos. Agora, o SEV-SNP 2.0<\/strong> do Zen 6<\/strong> vai al\u00e9m, adicionando criptografia de tabelas de p\u00e1ginas aninhadas e prote\u00e7\u00e3o contra ataques de replay \u2014 um vetor que anteriormente exigia hardware externo especializado.<\/p>\n

Na pr\u00e1tica, um provedor de nuvem que adote servidores EPYC Venice<\/strong> pode oferecer garantias criptogr\u00e1ficas de que nem mesmo seus administradores com acesso f\u00edsico ao rack conseguem acessar os dados de uma VM. A chave de criptografia \u00e9 gerada dentro do processador e nunca sai dele. A atesta\u00e7\u00e3o remota permite que o cliente verifique, antes de enviar qualquer carga de trabalho, se a m\u00e1quina est\u00e1 rodando um firmware \u00edntegro e se as prote\u00e7\u00f5es est\u00e3o ativas \u2014 algo similar ao que a Intel promete com TDX<\/strong>, mas com a maturidade de quem j\u00e1 est\u00e1 na quarta gera\u00e7\u00e3o da tecnologia.<\/p>\n

Outro avan\u00e7o crucial \u00e9 a introdu\u00e7\u00e3o de suporte a criptografia p\u00f3s-qu\u00e2ntica opcional<\/strong> no Zen 6<\/strong>. Embora os computadores qu\u00e2nticos capazes de quebrar RSA e ECC ainda estejam a alguns anos de dist\u00e2ncia, ag\u00eancias governamentais e setores como defesa e aeroespacial j\u00e1 exigem resili\u00eancia contra ataques do tipo \u201ccolher agora, decifrar depois\u201d. A AMD incluiu acelera\u00e7\u00e3o em hardware para algoritmos candidatos do NIST PQC<\/strong>, como CRYSTALS-Kyber<\/strong> e CRYSTALS-Dilithium<\/strong>, permitindo que a troca de chaves entre VMs e o hypervisor ocorra com primitivos p\u00f3s-qu\u00e2nticos sem degradar a performance.<\/p>\n

Para workloads de IA, o SEV-SNP 2.0<\/strong> se estende \u00e0s GPUs Instinct MI400<\/strong> via interconex\u00e3o Infinity Fabric<\/strong> criptografada. Dados que saem da CPU em dire\u00e7\u00e3o \u00e0 GPU para treinamento ou infer\u00eancia podem permanecer criptografados at\u00e9 o \u00faltimo n\u00edvel de cache da aceleradora, onde s\u00e3o decifrados apenas dentro do stream processor. \u00c9 um avan\u00e7o que coloca a AMD em posi\u00e7\u00e3o de vantagem frente \u00e0 NVIDIA, cuja tecnologia Confidential Computing para GPUs<\/strong> ainda depende de solu\u00e7\u00f5es mais complexas de enclave.<\/p>\n

Vulnerabilidades e mitiga\u00e7\u00f5es: o que o Zen 6 aprendeu com Sinkclose e Spectre<\/h3>\n

Nenhuma discuss\u00e3o sobre AMD Zen 6 seguran\u00e7a<\/strong> estaria completa sem examinar o legado de vulnerabilidades que atormentaram as gera\u00e7\u00f5es anteriores. O caso Sinkclose<\/strong>, revelado em 2024, foi um marco: uma falha no System Management Mode (SMM) que permitia a um atacante com acesso de root instalar malware persistente e invis\u00edvel ao sistema operacional. A corre\u00e7\u00e3o exigiu atualiza\u00e7\u00f5es de microc\u00f3digo distribu\u00eddas via AGESA<\/strong> e, em muitos casos, dependeu da boa vontade dos fabricantes de placas-m\u00e3e \u2014 um calcanhar de Aquiles que a AMD prometeu resolver no Zen 6<\/strong>.<\/p>\n

O EPYC Venice<\/strong> implementa uma nova pol\u00edtica de atualiza\u00e7\u00e3o de firmware que merece aplausos. O PSP 3.0<\/strong> pode receber patches de microc\u00f3digo diretamente do sistema operacional, sem necessidade de reboot ou interven\u00e7\u00e3o do BIOS. Isso \u00e9 poss\u00edvel gra\u00e7as a um subsistema de atualiza\u00e7\u00e3o at\u00f4mica que mant\u00e9m duas c\u00f3pias do firmware e faz a troca em tempo de execu\u00e7\u00e3o. Para administradores de grandes clusters, essa capacidade reduz de semanas para horas a janela entre a divulga\u00e7\u00e3o de uma CVE e a mitiga\u00e7\u00e3o completa do parque \u2014 um avan\u00e7o que pode ser a diferen\u00e7a entre um incidente contido e um vazamento catastr\u00f3fico.<\/p>\n

No front dos ataques especulativos, o Zen 6<\/strong> adota uma estrat\u00e9gia de partitioning<\/strong> que efetivamente elimina a classe de vulnerabilidades do tipo Spectre. Em vez de depender de mitigadores de software como Retpoline<\/strong> ou IBRS<\/strong> \u2014 que cobram ped\u00e1gio de performance \u2014, o hardware simplesmente n\u00e3o permite que uma thread acesse estruturas de predi\u00e7\u00e3o de outra thread que perten\u00e7a a um dom\u00ednio de seguran\u00e7a diferente. \u00c9 como se cada VM ou container tivesse seu pr\u00f3prio mini-processador especulativo, isolado por design. Benchmarks preliminares mostram que, ao contr\u00e1rio do que ocorria com Zen 4<\/strong> e Zen 5<\/strong>, ativar todas as mitiga\u00e7\u00f5es de seguran\u00e7a no Zen 6<\/strong> n\u00e3o reduz o desempenho em cargas como NGINX<\/strong>, Redis<\/strong> ou PostgreSQL<\/strong> \u2014 o que \u00e9 um al\u00edvio para engenheiros de performance.<\/p>\n

Para quem ainda opera servidores com g<\/p>\n

\n

Sua empresa precisa de infraestrutura com hardware de ponta?<\/p>\n

A JRT Technology Solutions dimensiona e gerencia servidores, workstations e esta\u00e7\u00f5es corporativas AMD \u2014 do desktop ao data center.<\/p>\n


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\n Falar com especialista
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Descubra como o AMD Zen 6 seguran\u00e7a e o EPYC Venice est\u00e3o redefinindo a prote\u00e7\u00e3o de dados. Clique e saiba mais sobre essa inova\u00e7\u00e3o!<\/p>\n","protected":false},"author":1,"featured_media":1794,"comment_status":"open","ping_status":"open","sticky":false,"template":"","format":"standard","meta":{"om_disable_all_campaigns":false,"_monsterinsights_skip_tracking":false,"iawp_total_views":2,"footnotes":""},"categories":[2495],"tags":[2532,2894,2533,2496,236,127],"class_list":["post-1795","post","type-post","status-publish","format-standard","has-post-thumbnail","hentry","category-amd","tag-amd-zen-6","tag-arquitetura-amd","tag-epyc-venice","tag-processadores-epyc","tag-protecao-de-dados","tag-seguranca-de-dados"],"aioseo_notices":[],"aioseo_head":"\n\t\t\n\t\n\t\n\t\n\t\n\t\n\t\n\t\t\n\t\t\n\t\t\n\t\t\n\t\t\n\t\t\n\t\t\n\t\t\n\t\t\n\t\t\n\t\t\n\t\t\n\t\t\n\t\t\n\t\t\n\t\t\n\t\t\n\t\t